在cpu内外常需设置多级高速缓存cache,主要目的是( )。A、扩大主存的存储容量B、提高cpu访问主存数据或指令的效率C、扩大存储系统的存量D、提高cpu访问内外存储器的速度

题目
在cpu内外常需设置多级高速缓存cache,主要目的是( )。

A、扩大主存的存储容量

B、提高cpu访问主存数据或指令的效率

C、扩大存储系统的存量

D、提高cpu访问内外存储器的速度

相似考题

1.高速缓冲存储器 Cache是位于CPU和主存DRAM之间规模或容量较小但速度很快的存储器。下面是关于Cache的叙述，其中错误的是( )。A．PC中采用的Cache方案兼顾了SRAM的高速特性和DRAM的低成本特性，即达到了即降低成本又提高系统性能的目的B．CPU访问Cache“命中”时，由于Cache的速度与CPU相当，因此CPU就能在零等待状态下迅速地完成数据的读写，而不必插入等待状态C．CPU访问CaChe“未命中”时，信息需从主存(DRAM)传送到CPU，这时CPU要插入等待状态D．L1 Cache的工作频率和CPU的工作频率相等，L2 Cache的工作频率越来越高，但不可能等于CPU的工作频率

2.有关高速缓冲存储器Cache的说法正确的是( )。A．只能在CPU以外B．CPU内外都可设置CacheC．只能在CPU以内D．若存在Cache，CPU就不能再访问内存

3.高速缓冲存储器Cache是位于CPU和主存DRAM之间规模或容量较小但速度很快的存储器。下面是关于Cache的叙述，其中错误的是( )。A．PC中采用的Cache方案兼顾了SRAM的高速特性和DRAM的低成本特性，即，达到了即降低成本又提高系统性能的目的B．CPU访问Cache“命中”时，由于Cache的速度与CPU相当，因此CPU就能在零等待状态下迅速地完成数据的读写，而不必插入等待状态C．CPU访问CaChe“未命中”时，信息需从主存(DRAM)传送到CPU，这时CPU要插入等待状态D．L1 Cache的工作频率和CPU的工作频率相等，L2 Cache的工作频率越来越高，但不可能等于CPU的工作频率

4.有关高速缓冲存储器Cache．的说法正确的是( )。A．只能在CPU以外B．CPU内外都可设置CacheC．只能在CPU以内D．若存在Cache，CPU就不能再访问内存

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  • 第1题：

    在cpu内外常需设置多级高速缓存cache，主要目的是（ ）。

    A.扩大主存的存储容量
    B.提高cpu访问主存数据或指令的效率
    C.扩大存储系统的容量
    D.提高cpu访问外存储器的速度

    答案：B
    解析：
    Cache存放的内容是主存内容的一部分副本，其目的是提高cpu访问主存数据或指令的效率。

  • 第2题：

    在CPU和主存之间增设高速缓存Cache的主要目的是提高CPU访问内存的速度。


    A

  • 第3题：

    在CPU和主存之间增设高速缓存（Cache）的主要目的是（）。

    A．提高CPU访问内存的速度

    B．提高CPU的运行速度

    C．扩充内存容量

    D．提高CPU访问外存的速度


    A 试题（10）分析 本题考查计算机系统基础知识。 Cache（高速缓冲存储器）是一种特殊的存储器子系统，其中复制了频繁使用的数据以利于快速访问。Cache 的出现是基于两种原因：首先是由于 CPU 的速度和性能提高很快而主存速度较低且价格高，其次就是程序执行的局部性特点。因此，将速度比较快而容量有限的SRAM构成Cache。目的在于尽可能发挥CPU的高速度。 参考答案 （10）A

  • 第4题：

    在 CPU 内外常设置多级高速缓存（Cache），其主要目的是（ ）。

    A.扩大主存的存储容量
    B.提高CPU访问主存数据或指令的效率
    C.扩大存储系统的容量
    D.提高CPU访问外存储器的速度

    答案：B
    解析：
    由于在CPU与存储系统之间存在着数据传送带宽的限制，因此在其中设置了Cache（高速缓冲存储器，简称高速缓存，通常速度比内存快），以提高整体效率。但由于其成本更高，因此Cache的容量要比内存小得多

  • 第5题：

    20、下面有关Cache的说法中正确的是（)

    A．设置Cache的目的，是解决CPU和主存之间的速度匹配问题

    B．设置Cache的理论基础，是程序访问的局部性原理

    C．Cache与主存统一编址，Cache地址空间是主存的一部分

    D．Cache功能均由硬件实现，对程序员透明


    设置Cache的目的，是解决CPU和主存之间的速度匹配问题;设置Cache的理论基础，是程序访问的局部性原理;Cache 功能均由硬件实现，对程序员透明

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