试确定图题3- 24所示74LS门电路的输出状态(设电源Vcc为5V)。图题3-24

题目

试确定图题3- 24所示74LS门电路的输出状态(设电源Vcc为5V)。

图题3-24

相似考题

1.试画出图4-6所示电路图在给定输入时钟作用下的输出波形.设触发器的初态为0.

2.试画出74HC与74LS系列逻辑门电路的输出逻辑电平与输入逻辑电平示意图。

3.试确定图题 3-25所示74HC门电路的输出状态(设电源Vcc为5 V)。图题3-25

4.试画出图题2-1 (a) 所示电路在输入图题2-1 (b)波形时的输出端B、C的波形。图题2-1

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第1题：

试确定图题3-26所示74LS门电路的输出负载是灌电流还是拉电流，并确定最大电流值。
图题3-26

答案：(1)输出低电平，因此是灌电流负载，保证输出为0.5V时的最大电流值为8mA。输出高电平，因此是拉电流负载，保证输出为2.7V时的最大电流值为0.4mA。
第2题：

试写出图题4-19所示加法器的输出。

答案：C_oS₂S₁S₀=1100
第3题：

试画出图题5-14所示各触发器输出Q端的波形，CLK、 A和B的波形如图所示。(设Q初始状态为0)

答案：
第4题：

试画出图题5-20所示电路中触发器输出Q1、Q2端的波形，CLK的波形如图所示。(设Q初始状态为0)

答案：
第5题：

画出图题5-10所示的JK触发器输出端Q端的波形，CLK的波形如图所示。(设Q初始状态为0)

答案：
第6题：

画出图题5-1所示的SR锁存器输出端Q、端的波形，输入端与的波形如图所示。(设Q初始状态为0)

答案：
第7题：

试画出图题5-12所示电路输出端Q1、Qo端的波形，CLK 的波形如图所示。(设Q初始状态为0)

答案：
第8题：

画出图题5-5所示的边沿触发D触发器输出端Q端的波形，输入端D与CLK的波形如图所示。(设Q初始状态为0)

答案：
第9题：

图题6-15所示的是5位右移寄存器与输入信号DATA、时钟CLK的波形图，若寄存器初始状态为00000，试画出寄存器输出Q4~Q0的波形图。

答案：
第10题：

试写出图题6-2所示状态图的状态表。

答案：（1）（2）
第11题：

试计算图题11-4所示电路的输出电压Vo。
答案：由图可知，D3~Do=0101因此输出电压为：
5.8位输出电压型R/2R电阻网络D/A转换器的参考电压为5V,若数字输入为10011001，该转换器输出电压Vo是多少?

答案：由图可知，D3~Do=0101因此输出电压为：
5.8位输出电压型R/2R电阻网络D/A转换器的参考电压为5V,若数字输入为10011001，该转换器输出电压Vo是多少?答案：
第12题：

如果将TTL逻辑门电路的输出采用下列接法会产生什么样的结果，试说明原因？（1）输出直接接地；（2）输出端直接接电源V_CC=+5V；（3）多个输出端并接一起。

正确答案:（1）如果将TTL逻辑门输出直接接地，在输出高电平时会烧坏逻辑门输出级的拉电路部分。
（2）如果将TTL逻辑门输出直接接V_CC=+5V，在输出低电平时会烧坏逻辑门输出级的推电路部分。
（3）如果多个TTL逻辑门输出端并接一起，当一个门的输出为高电平而另一个门的输出为低电平时，在电源和地之间形成一个低阻通路，产生一个很大电流I_HL，会使导通门输出低电平升高，破坏了电路原有的逻辑关系，因功耗过大损坏截止门中的导通管T₄，造成逻辑门损坏。所以，推拉结构的TTL门电路输出端是不允许直接连在一起使用。
第13题：

写出图题3-27所示电路的逻辑函数式。若是每个门的loL (max)= 20mA, VoL(max)=0.25V，假设Y端连接10个TTL负载。试求电源电压是5V情况下的最小上拉电阻值。
图题3-27

答案：逻辑函数式： Y=AB——·CD——·EF——若假设每个LS TTL低电平输入电流为0.4mA，则有：R_min= (Vcc-V_oLmax) / (I_oLmax- 10X0.4)= (5V-0.25V) / (20mA-4mA) ≈0.3kΩ
第14题：

画出图题5-9所示的正边沿触发JK触发器输出Q端的波形，输入端J、K与CLK的波形如图所示。(设Q初始状态为0)

答案：
第15题：

试画出图题5-15所示各触发器输出Q端的波形，CLK 的波形如图所示。(设Q初始状态为0)

答案：
第16题：

画出图题5-11所示的脉冲JK触发器输出Q端的波形，输入端J K与CLK的波形如图所示。(设Q初始状态为0)

答案：
第17题：

试画出图题5-19所示电路中触发器输出Q1、Q2端的波形，输入端CLK的波形如图所示。(设Q初始状态为0)

答案：
第18题：

试画出图题5-16所示触发器输出Q端的波形，CLK 的波形如图所示。(设Q初始状态为0)

答案：
第19题：

画出图题5-8所示的JK触发器输出Q端的波形，输入端JK与CLK的波形如图示。(设Q初始状态为0)

答案：
第20题：

试画出图题6-3所示的状态表的状态图。

答案：
第21题：

图题6-16所示的是8位右移寄存器74HC164符号、输入信号DATA、时钟CLK的波形图，若寄存器初始状态为0000000试画出寄存器输出QFQA的波形图。

答案：
第22题：

试写出图题6-4所示电路的驱动方程、状态方程、输出方程与状态图，并按
照所给波形画出输出端Y的波形。

答案：左图：
右图：由于状态方程=输出方程与左图一样，因此具有与左图相同的状态表、状态图与时序图。
第23题：

图所示电路为TTL门电路，输出状态为（　　）。

A．低电平
B．高电平
C．高阻态
D．截止状态

答案：A
解析：
左上第一个与门两输入分别为VCC和0，输出0作为右侧或非门的第一个输入；左下第二个与门输入管脚悬空，在TTL逻辑门电路中输入端悬空相当于输入高电平，此与门输出1作为右侧或非门的第二个输入；右侧或非门两输入分别为0和1，输出Y为0，即低电平。