什么是同步逻辑和异步逻辑?(汉王笔试)
第1题:
请画出用D触发器实现2倍分频的逻辑电路?(汉王笔试)
第2题:
请画出微机接口电路中,典型的输入设备与微机接口逻辑示意图(数据接口、控制接
口、所存器/缓冲器)。 (汉王笔试)
第3题:
什么是Setup 和Holdup时间?(汉王笔试)
第4题:
你知道那些常用逻辑电平?TTL与COMS电平可以直接互连吗?(汉王笔试)
常用逻辑电平:12V,5V,3.3V;TTL和CMOS不可以直接互连,由于TTL是在0.3-3.6V之间,而CMOS则是有在12V的有在5V的。CMOS输出接到TTL是可以直接互连。TTL接到CMOS需要在输出端口加一上拉电阻接到5V或者12V。
第5题:
时序逻辑电路的计数器取相应进制数少一经相应门电路送到()端。
第6题:
时序逻辑电路分为同步时序逻辑电路和异步时序逻辑电路两种它们的区别是()。
第7题:
什么是同步逻辑和异步逻辑?同步电路与异步电路有何区别同步电路与异步电路有何区别?
第8题:
时序逻辑电路的计数器计数模与规定值不符时,要检查清零端是同步还是异步清零。
第9题:
关于异步时序逻辑电路,下面表述不正确的是()。
第10题:
时序逻辑电路的计数器直接取相应的进制数相应门电路送到()端。
第11题:
第12题:
同步时序逻辑电路
异步时序逻辑电路
555定时器电路
脉冲产生电路
第13题:
可编程逻辑器件在现代电子设计中越来越重要,请问:a) 你所知道的可编程逻辑器件有哪些? b) 试用VHDL或VERILOG、ABLE描述8位D触发器逻辑。(汉王笔试)
PAL,PLD,CPLD,FPGA。
module dff8(clk , reset, d, q);
input clk;
input reset;
input d;
output q;
reg q;
always @ (posedge clk or posedge reset)
if(reset)
q <= 0;
else
q <= d;
endmodule
第14题:
什么是"线与"逻辑,要实现它,在硬件特性上有什么具体要求?(汉王笔试)
线与逻辑是两个输出信号相连可以实现与的功能。在硬件上,要用oc门来实现,由于不用oc门可能使灌电流过大,而烧坏逻辑门。同时在输出端口应加一个上拉电阻。
第15题:
什么是竞争与冒险现象?怎样判断?如何消除?(汉王笔试)
在组合逻辑中,由于门的输入信号通路中经过了不同的延时,导致到达该门的时间不一致叫竞争。产生毛刺叫冒险。如果布尔式中有相反的信号则可能产生竞争和冒险现象。解决方法:一是添加布尔式的消去项,二是在芯片外部加电容。
第16题:
下列的()不是寄存器的基本逻辑功能。
第17题:
异步时序逻辑电路与同步时序逻辑电路有哪些主要区别?
第18题:
下列属于时序逻辑电路的是()。
第19题:
什么是同步逻辑和异步逻辑?同步电路与异步电路有何区别?
第20题:
下面()不是时序电路的种类。
第21题:
关于同步时序逻辑电路,下面表述正确的是()。
第22题:
同步时序逻辑电路状态的变化与时钟脉冲同步,而异步时序电路中没有统一的时钟脉冲,电路的状态随输入信号的改变而相应改变。
异步时序电路的每个状态都是“稳定状态”,而同步时序逻辑电路的状态分为“稳定”和“不稳定“两种。
同步时序电路中,任一时刻,几个输入变量可以同时变化。
异步时序电路中,每个时刻仅允许一个输入信号发生变化,以避免电路中可能出现的竞争现象。
第23题: