半加法器和全加法器的区别是（）。A、是否产生进位B、是否处理以前的进位C、是否产生和位D、是否处理以前的和位

题目

半加法器和全加法器的区别是（）。

  • A、是否产生进位
  • B、是否处理以前的进位
  • C、是否产生和位
  • D、是否处理以前的和位
相似考题

1.加法器有串行进位和并行进位两种连接方式:()A、串行进位加法器的电路结构简单，工作速度慢。B、并行进位加法器的速度快，电路结构复杂。C、串行进位加法器的电路结构简单，工作速度快。D、并行进位加法器的速度慢，电路结构简单。

2.与4位串行进位加法器比较,使用超前进位全加器的目的是( )A.完成自动加法进位B.完成4位加法C.完成4位串行加法D.提高运算速度

3.前进位加法器比串行进位加法器速度慢。()此题为判断题(对，错)。

4.串行进位加法器电路简单、但速度较慢,并行进位加法器速度较快、但电路复杂。()此题为判断题(对，错)。

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  • 第1题：

    超前进位加法器比行波加器要简单()


    参考答案错误

  • 第2题：

    判断是否溢出时用PSW的()标志位，判断是否有进位时用PSW的()标志位。

    A、CY

    B、OV

    C、P

    D、RS0

    D、RS1


    参考答案：B

  • 第3题：

    判断是否有进位时用PSW的()标志位。

    A.CY

    B.OV

    C.P

    D.AC


    正确答案:A

  • 第4题：

    影响加法器运算速度的主要因素是(5)。

    A．组成全加器的元器件的工作速度

    B．串行进位链的总延迟时间

    C．所有本地进位di产生的速度

    D．所有全加和Qi产生的速度


    正确答案：B
    解析：本题考查加法器的组成。加法器的主要功能是对数进行加法运算，在大多数的中央处理器中，很多其他计算也是经过变换后使用加法器来完成的，一个位加法的逻辑图如下图所示。在上图中，Xi、Yi是加数和被加数；Ci+1是低位进位；Ci是进位；Zi是和。在加法运算器进行运算时，第f位的和除与本位操作数Xi和Yi有关外，还依赖．于低位进位信号，而低位进位信号依赖于更低位的进位信号，而这样的进位逻辑就是串行进位链。因此影响加法器运算速度的主要因素是串行进位链的总延迟时间，而加法器本身求和的延迟时间反而是次要的。

  • 第5题：

    全加器是由两个加数Xi和Yi以及低位来的进位Ci-1作为输入，产生本位和S，以及向高位的进位Ci的逻辑电路。(51)和(52)分别是Si和Ci的正确逻辑表达式。全加器亦可通过半加器来实现，此时Si=(53)。若某计算机采用8位带符号补码表示整数，则可由8个全加器(i=1,2,……8,i=8为最高位，即符号位)串接构成8位加法器，C0=0。该加法器有一个状态寄存器，记录运算结果的状态。其中，N和V分别表示符号位与溢出标志位，则其逻辑表达式分别为(54)和(55)。

    A．

    B．

    C．

    D．


    正确答案：D
    解析：本位和为1可以分解为：当两加数与低进位均为1的情况(Xi+Yi+Ci-1)；当没有进位产生时，两加数、低进位有一个为1的情况Ci(Xi+Yi+Ci-1)。本位进位为1即两加数、低进位同时最少有两个为1的情况，即XiYi+XiCi-1+YiCi-1。半加器异或的作用，Si可表示为两加数、低进位三者若有两个相同，则Si为1，即Xi⊕C⊕i-1Yi。8位加法器中，若C7为0，则符号位由X8.Y8决定，进行异或即可，或表示为x8+y8。若C7为1，则可表示成+x8y8，即C7(+x8y8)+(x8+y8)。若C8=1，表示符号位运算产生进位，此时若C7=0，表示低位没有进位，说明是两加数的符号位运算产生了进位，则结果符号位必然不同于两加数的符号，产生溢出；否则，没有溢出。若C8=0，表示c7，x8，y8，最多有一个是1，若C7=1，说明符号位改变，产生溢出。这种情况可以用半加表示，即C7.C8。

  • 第6题：

    在串行进位的并行加法器中，影响加法器运算速度的关键因素是()。

    A.门电路的级延迟
    B.元器件速度
    C.进位传递延迟
    D.各位加法器速度的不同

    答案：C
    解析：
    加法器是整个运算器的核心，提高加法器的运算速度最直接的方法就是多位并行加法。本题中4个选项均会对加法器的速度产生影响，但只有进位传递延迟对并行加法器的影响最为关键。

  • 第7题：

    加法器中进位产生函数是（）

    • A、Ai+Bi
    • B、Ai⊕Bi
    • C、Ai-Bi
    • D、AiBi

    正确答案:D

  • 第8题：

    在程序状态寄存器PSW中，判断是否有借/进位的标志位是（），若选择寄存器工作组时标志位应是（）。


    正确答案:CY；RS1

  • 第9题：

    判断是否有进位时用PSW的（）标志位。

    • A、CY
    • B、OV
    • C、P
    • D、AC

    正确答案:A

  • 第10题：

    并行加法器采用超前进位的目的是简化电路结构。


    正确答案:错误

  • 第11题：

    单选题
    加法器采用并行进位的目的是（）。
    A

    提高加法器的速度

    B

    快速传递进位信号

    C

    优化加法器结构

    D

    增强加法器功能


    正确答案： D
    解析： 暂无解析

  • 第12题：

    单选题
    半加法器和全加法器的区别是（）。
    A

    是否产生进位

    B

    是否处理以前的进位

    C

    是否产生和位

    D

    是否处理以前的和位


    正确答案： D
    解析： 暂无解析

  • 第13题：

    提高并行加法器速度的关键是尽量加快进位产生和传递的速度。()

    此题为判断题(对，错)。


    正确答案:正确

  • 第14题：

    加法器有串行进位和()进位之分。


    参考答案：超前

  • 第15题：

    半加法器和全加法器的区别是

    A. 是否产生进位

    B. 是否处理以前的进位

    C. 是否产生和位

    D. 是否处理以前的和位


    正确答案：B

  • 第16题：

    全加器是由两个加数Xi和Yi以及低位来的进位Ci-1作为输入，产生向高位的进位Ci以及本位利Si的逻辑电路。(65)和(66)分别是进位和本位和的正确逻辑表达式。全加器亦可通过半加器来实现，此时Si=(67)。若某计算机采用8位带符号补码表示整数，则可由8个全加器(i =1，2，……8，i=8为最高位，即符号位)串接构成8位加法器，CO=0。该加法器有一个状态寄存器，记录运算结果的状态。其中，N和V分别表示符号位与溢出标志位，则其逻辑表达式分别为(68)和(69)。

    A．XiYi+XiCi-1+YiCi-1

    B．XiYi+XiSj+YiSi

    C．XiYi+XiCi-1+YiCi-1

    D．(XiYi+XiYi).Ci-1


    正确答案：C

  • 第17题：

    定点运算器中判断溢出的条件是()。

    A.最高符号位产生进位
    B.符号位进位和最高数值位进位同时产生
    C.用般符号位表示数符，当运算结果的两个符号位不相同时
    D.用艘符号位表示数符，当运算结果的两个符号位相同时

    答案：B
    解析：
    用般符号法表示数符时，结果的两个符号位代码不一致时，表示溢出(01表示上溢，10表示下溢)，两个符号位的代码一致时，表示没有溢出，最高符号位永远表示结果的正确符号。

  • 第18题：

    加法器采用并行进位的目的是（）。

    A提高加法器的速度

    B快速传递进位信号

    C优化加法器结构

    D增强加法器功能


    B
    略

  • 第19题：

    实现两个一位二进制数和低位进位数相加产生和数及进位数的电路称为半加器。


    正确答案:错误

  • 第20题：

    逻辑运算中位与位之间有时会产生进位和借位。


    正确答案:错误

  • 第21题：

    判断是否有半字节进位时用PSW的（）。


    正确答案:AC标志位

  • 第22题：

    与4位串行进位加法器比较，使用超前进位全加器的目的是（）。

    • A、完成自动加法进位
    • B、完成4位加法
    • C、提高运算速度
    • D、完成4位串行加法

    正确答案:C

  • 第23题：

    单选题
    与4位串行进位加法器比较，使用超前进位全加器的目的是（）。
    A

    完成自动加法进位

    B

    完成4位加法

    C

    提高运算速度

    D

    完成4位串行加法


    正确答案： C
    解析： 暂无解析

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